Avago Technologies LSI53C876E - Manual (Page 74)

3-2 Signal Descriptions
Figure 3.1 LSI53C876 208-Pin PQFP Diagram
1
3
5
7
9
11
13
15
17
19
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46
48
50
52
LSI53C876
2
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153
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108
106
157 159 161 163 165 167 169 171 173 175 177 179 181 183 185 187 189 191 192 193 194 195 196 198 200 202 204 206 208 158 160 162 164 166 168 170 172 174 176 178 180 182 184 186 188 190 197 199 201 203 205 207
53 55 57 59 61 63 65 67 69 71 73 75 77 79 81 83 85 87 88 89 90 91 92 94 96 98 100 102 104 54 56 58 60 62 64 66 68 70 72 74 76 78 80 82 84 86 93 95 97 99 101 103
Note: NC pins are not connected.
AD26
VSS
AD25
AD24
C_BE3/
VDD-IO
IDSEL
AD23
VSS
AD22
AD21
AD20
VDD-IO
AD19
VSS
AD18
AD17
AD16
VSS
C_BE2/
FRAME/
VDD-IO
IRDY/
VSS
TRDY/
DEVSEL/
NC
STOP/
VSS
PERR/
VDD-IO
SERR/
PAR
C_BE1/
VSS
AD15
AD14
AD13
VDD-IO
AD12
VSS
AD11
AD10
AD9
VSS
AD8
VDD-IO
C_BE0/
AD7
AD8
VSS
AD5
A_S07/
A_SDP0/
A_SATN/
VSS-S
A_SBSY/
A_SACK/
A_SRST/
A_SMSG/
A_SSEL/
VSS-S
A_SC_0/
A_SREQ/
A_SI_0/
A_SD8/
VSS-S
A_SD9/
A_SD10/
A_SD11/
VDD
A_SDIR8
A_SDIR9
A_SDIR10
A_SDIR11
VSS
A_BSYDIR
VDD-C
A_RSTDIR
VSS-C
A_SELDIR
A_IOS
A_TGS
A_DIFFENS
VDD
B_SD12/
B_SD13/
B_SD14/
VSS-S
B_SD15/
B_SDP1/
B_SD0/
B_SD1/
VSS-S
B_SD2/
B_SD3/
B_SD4/
B_SD5/
VSS-S
B_SD6/
B_SD7/
B_SDP0/
B_SATN/
VSS-S
AD27 AD28 VDD-A0 AD29 VSS AD30 AD31 VDD-C REQ/ GNT/ VSS-C CLK RST/ INT
A/
INTB/ MCE/ MASQ/ MOE/_TEST
OUT
MWE/ MAS1/ VSS A_SDIR12 VDD A_SDIR13 A_SDIR14 A_SDIR15 A_SDIR0 A_SDIR1 A_SDIR2 A_SDIR3 VSS A_SDIR4 A_SDIR5 A_SDIR6 A_SDIR7 A_SDIRP0/1 VDD A_SD12/ A_SD13/ A_SD14/ VSS-S A_SD15/ A_SDP1/ A_SD0/ A_SD1/ VSS-S A_SD2/ A_SD3/ A_SD4/ A_SD5/ VSS-S A_SD6/
AD4 AD3
VDD-10
AD2 VSS AD1 AD0 TCK
TDI
TMS TD0
VDD-C
SCLK
TESTIN/
VSS-C
A_GPIO0_FETCH/
A_GPIO1_MASTER/
A_GPIO2 A_GPIO3
VSS
A_GPIO4
MAD7
VDD
MAD6 MAD5
NC
MAD4 MAD3 MAD2 MAD1 MAD0
B_GPIO1_FETCH/
VSS
B_GPIO1_MASTER
B_GPIO2 B_GPIO3 B_GPIO3
VDD
B_SD11/ B_SD10/
B_SD9/
VSS-S
B_SD8/ B_SI_0/
B_SREQ/ B_SC_D/
VSS-S
B_SSEL/
B_SMSG/ B_SRST/ B_SA
CK/
B_SBSY/
208L PQFP
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